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【2h】

Power Grid Optimization in 3D Circuits U s i n g MIM and CMOS Decoupling Capacitors

机译：三维电路中的电网优化采用mIm和CmOs去耦电容

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Pingqiang Zhou; Karthikk Sridharan; Sachin S. Sapatnekar;
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年度 2016
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1. Optimizing Decoupling Capacitors in 3D Circuits for Power Grid Integrity [J] . Pingqiang Zhou, Sridharan K., Sapatnekar S.S. Design & Test of Computers, IEEE . 2009,第5期

机译：优化3D电路中的去耦电容器以实现电网完整性
2. Development of Embedded Three-Dimensional 35-nF/mm2 MIM Capacitor and BiCMOS Circuits Characterization [J] . Giraudin J.-G.., Badets F.., Blanc J.-P.., IEEE Journal of Solid-State Circuits . 2007,第9期

机译：嵌入式三维35nF / mm2 MIM电容器的开发和BiCMOS电路特性
3. A comparison study of EM and physical equivalent circuit modeling for MIM CMOS capacitors [J] . X. Z. Xiong, V. F. Fusco Microwave and optical technology letters . 2002,第3期

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4. Congestion-aware power grid optimization for 3D circuits using MIM and CMOS decoupling capacitors [C] . Zhou Pingqiang, Sridharan Karthikk, Sapatnekar Sachin S. Design Automation Conference, 2009. ASP-DAC 2009 . 2009

机译：使用MIM和CMOS解耦电容器对3D电路进行拥塞感知的电网优化
5. High performance power distribution networks with on-chip decoupling capacitors for nanoscale integrated circuits [D] . Popovich, Mikhail 2008

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